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QFN 焊盤設(shè)計(jì)
QFN器件的焊盤尺寸、焊膏印 刷面積與它的引腳尺寸是同樣大小 的，而且器件的引腳是交錯(cuò)排列在 封裝體底部的(圖8)。
因此，QFN的 焊盤設(shè)計(jì)建議為：焊盤伸出于器件引腳的外端， 而
縮進(jìn)于器件的內(nèi) 端，這樣使得在器件引腳的內(nèi)外形成彎月型焊盤。在這里 很重要的一點(diǎn)是，在進(jìn)行設(shè)計(jì)計(jì)算時(shí)必須考慮器件的公差范圍。(圖9)
BGA 設(shè)計(jì)
在BGA設(shè)計(jì)時(shí)，焊點(diǎn)的形狀（如淚滴型）可以通過(guò)特 別的布局使其成為可見的；就是說(shuō)，淚滴型的焊點(diǎn)除了具 有奇怪的形狀外，它的方向也是很隨意的?？偠灾?nbsp;器件面的焊盤和在PCB上的焊盤正好和BGA焊球的大小是 一樣的（圖
10 ）。在德國(guó)Erlangen 大學(xué)，學(xué)者做了大量的 研究去評(píng)價(jià)單個(gè)焊盤形狀的模型；他們發(fā)現(xiàn)，無(wú)論焊盤是 圓形還是非圓形的，焊膏印刷圖形要保持為圓形不變。

IEEE1149.1定義了一個(gè)掃描器件的幾個(gè)重要特性。先定義了組成測(cè)試訪問(wèn)端口（TAP）的四（五〕個(gè)管腳：TDI、TDO、TCK、TMS，（TRST）。測(cè)試方式選擇（TMS）用來(lái)加載控制信息；其次定義了由TAP控制器支持的幾種不同測(cè)試模式，主要有外測(cè)試（EXTEST）、內(nèi)測(cè)試（INTEST）、運(yùn)行測(cè)試（RUNTEST）；提出了邊界掃描語(yǔ)言（Boundary Scan Description Language），BSDL語(yǔ)言描述掃描器件的重要信息，它定義管腳為輸入、輸出和雙向類型，定義了TAP的模式和指令集。
具有邊界掃描的器件的每個(gè)引腳都和一個(gè)串行移位寄存器（SSR）的單元相接，稱為掃描單元，掃描單元連在一起構(gòu)成一個(gè)移位寄存器鏈，用來(lái)控制和檢測(cè)器件引腳。其特定的四個(gè)管腳用來(lái)完成測(cè)試任務(wù)。
將多個(gè)掃描器件的掃描鏈通過(guò)他們的TAP連在一起就形成一個(gè)連續(xù)的邊界寄存器鏈，在鏈頭加TAP信號(hào)就可控制和檢測(cè)所有與鏈相連器件的管腳。這樣的虛擬接觸代替了針床夾具對(duì)器件每個(gè)管腳的物理接觸，虛擬訪問(wèn)代替實(shí)際物理訪問(wèn)，去掉大量的占用PCB板空間的測(cè)試焊盤，減少了PCB和夾具的制造費(fèi)用。
作為一種測(cè)試策略，在對(duì)PCB板進(jìn)行可測(cè)性設(shè)計(jì)時(shí)，可利用軟件分析電路網(wǎng)點(diǎn)和具掃描功能的器件，決定怎樣有效地放有限數(shù)量的測(cè)試點(diǎn)，而又不減低測(cè)試覆蓋率，經(jīng)濟(jì)的減少測(cè)試點(diǎn)和測(cè)試針。

AOI（Automated Optical Inspection縮寫）的中文全稱是自動(dòng)光學(xué)檢測(cè)，是基于光學(xué)原理來(lái)對(duì)焊接生產(chǎn)中遇到的常見缺陷進(jìn)行檢測(cè)的設(shè)備。AOI是新興起的一種新型測(cè)試技術(shù)，但發(fā)展迅速，很多廠家都推出了AOI測(cè)試設(shè)備。當(dāng)自動(dòng)檢測(cè)時(shí)，機(jī)器通過(guò)攝像頭自動(dòng)掃描PCB，采集圖像，測(cè)試的焊點(diǎn)與數(shù)據(jù)庫(kù)中的合格的參數(shù)進(jìn)行比較，經(jīng)過(guò)圖像處理，檢查出PCB上缺陷，并通過(guò)顯示器或自動(dòng)標(biāo)志把缺陷顯示/標(biāo)示出來(lái)，供維修人員修整。
運(yùn)用高速高精度視覺(jué)處理技術(shù)自動(dòng)檢測(cè)PCB板上各種不同貼裝錯(cuò)誤及焊接缺陷。PCB板的范圍可從細(xì)間距高密度板到低密度大尺寸板，并可提供在線檢測(cè)方案，以提高生產(chǎn)效率，及焊接質(zhì)量。通過(guò)使用AOI作為減少缺陷的工具，在裝配工藝過(guò)程的早期查找和消除錯(cuò)誤，以實(shí)現(xiàn)良好的過(guò)程控制。早期發(fā)現(xiàn)缺陷將避免將壞板送到隨后的裝配階段，AOI將減少修理成本將避免報(bào)廢不可修理的電路板。

上面的測(cè)試方法是針對(duì)立的器件，而實(shí)際電路上器件相互連接、相互影響，使Ix笽ref，測(cè)試時(shí)必須加以隔離（Guarding）。隔離是在線測(cè)試的基本技術(shù)。
在上電路中，因R1、R2的連接分流，使Ix笽ref ，Rx = Vs/ V0*Rref等式不成立。測(cè)試時(shí)，只要使G與F點(diǎn)同電位，R2中無(wú)電流流過(guò)，仍然有Ix=Iref，Rx的等式不變。將接地，因F點(diǎn)虛地，兩點(diǎn)電位相等，則可實(shí)現(xiàn)隔離。實(shí)際實(shí)用時(shí)，通過(guò)一個(gè)隔離運(yùn)算放大器使G與F等電位。ICT測(cè)試儀可提供很多個(gè)隔離點(diǎn)，消除電路對(duì)測(cè)試的影響。
1.2 IC的測(cè)試
對(duì)數(shù)字IC，采用Vector（向量）測(cè)試。向量測(cè)試類似于真值表測(cè)量，激勵(lì)輸入向量，測(cè)量輸出向量，通過(guò)實(shí)際邏輯功能測(cè)試判斷器件的好壞。
如:與非門的測(cè)試
對(duì)模擬IC的測(cè)試，可根據(jù)IC實(shí)際功能激勵(lì)電壓、電流，測(cè)量對(duì)應(yīng)輸出，當(dāng)作功能塊測(cè)試。
非向量測(cè)試
隨著現(xiàn)代制造技術(shù)的發(fā)展，超大規(guī)模集成電路的使用，編寫器件的向量測(cè)試程序常?；ㄙM(fèi)大量的時(shí)間，如80386的測(cè)試程序需花費(fèi)一位熟練編程人員近半年的時(shí)間。SMT器件的大量應(yīng)用，使器件引腳開路的故障現(xiàn)象變得更加突出。為此各公司非向量測(cè)試技術(shù)，Teradyne推出MultiScan；GenRad推出的Xpress非向量測(cè)試技術(shù)。
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